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首页-成都FPGA/CPLD初级班-FPGA/CPLD软硬件开发设计培训学校招生简章:
FPGA/CPLD初级班-FPGA/CPLD软硬件开发设计[成都]ChinaEDA嵌入式技术培训中心
学费（参考）：1500 | 学制：30学时 | 名额：20 | 形式：面授
报名：
[在线报名咨询]
电邮：ygm1976 [@] 163.com
QQ：46696610
地址：成都市科华北路47号（川大科技大厦）606 室
网站：http://www.chinaeda.cn/ [弹出窗口]
发布：2007-9-10
FPGA/CPLD初级班-FPGA/CPLD软硬件开发设计
>>> 课程目标
通过本期培训不但能够使学员掌握Verilog HDL语言以及FPGA/CPLD软硬件开发设计的方法与流程，而且能够利用FPGA/CPLD做小项目的开发设计。
>>> 入学要求
理工科类大专以上学历;喜欢并有志投身于IT事业;具备一定硬件知识;
>>> 实验器材
XC3S 400 开发板
>>> 实训项目
>>> 质量保障
◆ 雄厚的师资力量、经典完善的课程体系、提供丰富的课程录象及完善的教学管理确保教学质量;
◆ 培训结束后免费提供一年的技术支持，充分保证培训后出效果； ◆ 本期如有未学懂的内容下期可免费再学；
◆ 入学即签推荐就业协议；
>>> 开课情况
◆ 开课时间:
待定 ◆ 学 时:
总计: 30学时 ◆ 培训费用：（含教材费） 学生: 900.00元(凭有效证件）其他:1500.00元 ◆ 上课地点：（中嵌教育本部）成都市科华北路47号（川大科技大厦） ◆ 外地学员：可协助安排食宿（须提前预定）
>>> 具体课程安排
第一篇 FPGA/CPLD软硬件开发设计概述（2学时）
1，FPGA/CPLD的特点、基本原理
2，FPGA/CPLD开发设计步骤
3，实时信号处理系统的技术难点及解决办法
4，如何设计复杂的数字逻辑系统
第二篇 Verilog HDL设计（6学时）
1，Verilog HDL设计方法概述
2，简单的Verilog HDL模块
3，数据类型、常量、变量、运算符及其表达式
4，阻塞赋值和非阻塞赋值
5，条件语句、循环语句以及结构说明语句
6，系统函数、任务以及编译预处理
7，实验与辅导1：时钟发生器
8，实验与辅导2：16位乘法器芯片设计
第三篇 FPGA/CPLD软硬件开发设计及实验与辅导（12学时）
1，ISE系统简介
2，ISE的工程管理器与设计输入工具
3，ISE中集成的综合工具
4，实验与辅导3：自动控制分频器
5，Modelsim仿真工具的安装与使用
6，实验与辅导4：实时信号检测器
7，IP核生成工具以及设计结构向导的使用
8，实验与辅导5：利用IP核生成工具实现波形发生器
9，实验与辅导6：利用设计结构向导实现小数倍分频器
第四篇 开发电路板设计原理及实验与辅导（5学时）
1，开发电路板设计原理
2，ISE中的约束、配置工具以及在线逻辑分析仪的使用
3，实验与辅导7：基于开发电路板的实验与辅导
第五篇 综合实验与辅导：基于开发电路板的全功能电子抢答器（5学时）
其它培训课程招生信息：
武昌日语
武昌韩语。
北京DOTNET周末班
北京VC++定向委培
北京<精确管理>
北京Java高级软件工程师班
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